差分的匹配多数采用终端的匹配；时钟采用源段匹配

        传输线的端接通常采用两种策略：

（1）使负载阻抗与传输线阻抗匹配，即并行端接（2）使源阻抗与传输线阻抗匹配，即串行端接。

（1）并行端接
        并行端接主要是在尽量靠近负载端的位置加上拉和/或下拉阻抗以实现终端的阻抗匹配。
（2）串行端接
        串行端接是通过在尽量靠近源端的位置串行插入一个电阻RS（典型10Ω到75Ω）到传输线中来实现的，插入的串行电阻阻值加上驱动源的输出阻抗应等于传输线阻抗。

1、 串联终端匹配
       串联终端匹配的理论出发点是在信号源端阻抗低于传输线特征阻抗的条件下，在信号的源端和传输线之间串接一个电阻R，使匹配电阻值与驱动器的输出阻抗之和与传输线的特征阻抗相等，抑制从负载端反射回来的信号发生再次反射.

串联匹配不要求信号驱动器具有很大的电流驱动能力。
串联终端匹配电阻值的原则：

        要求匹配电阻值与驱动器的输出阻抗之和与传输线的特征阻抗相等。理想的信号驱动器的输出阻抗为零，实际的驱动器总是有比较小的输出阻抗，而且在信号的电平发生变化时，输出阻抗可能不同。

        比如电源电压为＋4.5V的CMOS驱动器，在低电平时典型的输出阻抗为37Ω，在高电平时典型的输出阻抗为45Ω；

        TTL驱动器和CMOS驱动一样，其输出阻抗会随信号的电平变化而变化。因此，对TTL或CMOS电路来说，不可能有十分正确的匹配电阻，只能折中考虑。

        串联匹配是最常用的终端匹配方法。它的优点是功耗小，不会给驱动器带来额外的直流负载，也不会在信号和地之间引入额外的阻抗；而且只需要一个电阻元件。

2、 并联终端匹配
        并联终端匹配的理论出发点是在信号源端阻抗很小的情况下，通过增加并联电阻使负载端输入阻抗与传输线的特征阻抗相匹配，达到消除负载端反射的目的。实现形式分为单电阻和双电阻两种形式。
        在实际的电路系统中，芯片的输入阻抗很高，因此对单电阻形式来说，负载端的并联电阻值必须与传输线的特征阻抗相近或相等。

        假定传输线的特征阻抗为50Ω，则R值为50Ω。如果信号的高电平为5V，则信号的静态电流将达到100mA。由于典型的TTL或CMOS电路的驱动能力很小，这种单电阻的并联匹配方式很少出现在这些电路中。
        双电阻形式的并联匹配，也被称作戴维南终端匹配，要求的电流驱动能力比单电阻形式小。这是因为两电阻的并联值与传输线的特征阻抗相匹配，每个电阻都比传输线的特征阻抗大。考虑到芯片的驱动能力，两个电阻值的选择必须遵循三个原则：
⑴． 两电阻的并联值与传输线的特征阻抗相等；
⑵． 与电源连接的电阻值不能太小，以免信号为低电平时驱动电流过大；
⑶． 与地连接的电阻值不能太小，以免信号为高电平时驱动电流过大。

        并联终端匹配优点是简单易行；

        缺点是会带来直流功耗：

单电阻方式的直流功耗与信号的占空比紧密相关；

双电阻方式则无论信号是高电平还是低电平都有直流功耗。因而不适用于电池供电系统等对功耗要求高的系统。

另外，单电阻方式由于驱动能力问题在一般的TTL、CMOS系统中没有应用，而双电阻方式需要两个元件，这就对PCB的板面积提出了要求，因此不适合用于高密度印刷电路板。

3、反射
        当从负载端反射回的电压到达源端时，又将再次反射回负载端，叫做二次反射波